《数字电子技术（第二版）》课后习题参考答案课题一认识数字电路任务一认识数制与数制转换一、填空题1．1 232．1 273．1 2154．1 2315．B O D H二、计算题1．2．54，85，4273．0101，1100，1 1000，11 01114．17O，37O，66 O5．110B，010 111B，001 101 110B6．0FH，36H，0AE63H7．0001 0110B，0010 1010B，1111 1100 0000B任务二学习二进制数算术运算一、计算题（给出的二进制均是无符号数）1．（1）1 0000 （2）1 0000 10012．（1）10 1010 （2）1010 11113．（1）1 0100 （2）110 00004．（1）101 （2）11二、写出下列带符号位二进制数（原码）所表示的十进制数（1）+110 （2）-15 （3）-42 （4）+127 （5）+111（6）-63 （7）+0 （8）+32 767 （9）-32 768三、问答题1．（1）答：左移，移动3位，应作乘以8运算。

（2）答：左移，移动4位，应作乘以16运算。

（3）答：右移，移动7位，应作除以128运算。

（4）答：右移，移动3位，应作除以8运算。

2．答：4位二进制无符号数的最大值是15。

3．答：8位二进制无符号数、有符号数的最大值分别是255和+127。

4．答：16位二进制有符号数的最大值是+32 767。

任务三学习二进制代码一、填空题1．二进制数2．43．8，4，2，1二、判断题1．×2．× 3．√ 4．× 5．× 6．×三、计算题1．36，55，892．［0011 0010］8421，［0101 0010 0111］8421，［0001 0011 0110 1001］8421任务四认识基本逻辑关系并测试逻辑门一、填空题1．与或非2．13．04．1 05．Y=AB6．Y=A+B7．Y=A8．Y=AB9．Y=A+B10．Y=A B=AB+AB二、选择题1．D 2．A 3．B，C 4．A，D三、判断题1．× 2．× 3．× 4．√四、问答题1．答：Y1=ABCD2．答：Y2=A+B+C+D五绘图题1．2．3．4．任务五测试TTL集成门电路1．答：TTL集成门电路电源电压范围为4.75～5.25V之间，额定电压为5V。

2．答：与逻辑的多余输入端可直接或通过电阻（100Ω～10kΩ）与电源U CC相接，或将多余的输入端与正常使用的输入端并联使用。

或逻辑的多余输入端不能悬空，只能接地。

3．答：对于多余的输出端，应该悬空处理，不允许直接与电源或地相连接。

但有时为了增大驱动负载的能力，对于同片相同功能的输出端可以并接，同时输入端也必须并接。

4．答：OC门电路的输出端未连接负载电阻和电源，正常工作时需要外接负载电阻和驱动电压。

OC门在逻辑功能上可以实现“线与”逻辑，即两个以上的OC门的输出端可以直接连接（通过负载电阻接电源），当其中某一个输出端为低电平时，公共输出端为低电平，即实现“线与”逻辑功能。

非OC门电路的输出端不能连接，所以不能实现“线与”逻辑。

5．答：外接驱动电压应选择9V。

6．答：3态门除高电平和低电平两种输出状态外，还有第三种输出状态—高阻态（Z）。

3态门的特点使得在总线上可以连接多个3态门的输出端，轮流接收来自不同3态门的输出信号。

7．答：（1）输出低电平。

（2）输出低电平。

（3）输出高电平。

（4）输出高电平。

（5）输出高电平。

（6）输出低电平。

任务六测试CMOS集成门电路一、选择题1．D 2．B二、判断题1．√ 2．√ 3．√ 4．× 5．× 6．√任务八 化简逻辑函数一、填空题1．0 2．1 3．1 4．1 5．0 6．0 7．0 8．1 9．0，1 10．0 11．1 12．A 13．1 14．A 15．1 16．0 17．A 18．A 19．0 二、化简题1． 2．Y=AB+B+AB =AB+B(1+A) =AB+B =A+BY=ABC+A+B+C+D=ABC+ABC+D=1+D =13． 4．Y=ABC+AB+AD+A D =AB(C+1)+(A+A)D =AB+D⋅ Y=AB+AB+AB =A(B+B)+(A+A)B =A+B5．Y=A(A+B)(A+B)(A+B) =AB(A B+AB) =AB A B+AB AB =0⋅⋅⋅⋅课题二组装和测试组合逻辑电路任务一分析和测试给定的组合逻辑电路1．答：组合逻辑电路的特点是任意时刻的输出状态仅取决于当时的输入状态，而与电路过去状态无关。

2．答：分析组合逻辑电路可按如下步骤进行：（1）按信号传递方向由后向前逐级写出电路的逻辑函数式。

（2）由逻辑函数式列出真值表。

（3）根据真值表分析逻辑功能。

3．答：图2-3所示组合逻辑电路是同或门逻辑。

4．答：由真值表可知，当3个输入变量A，B，C取值一致时，输出Y=1，否则Y=0。

所以这个逻辑电路可以判断3个输入变量的取值是否一致，故称为输入一致判别逻辑电路。

任务二设计和测试“四舍五入”逻辑电路1．答：设计组合逻辑电路可按以下步骤进行：（1）根据设计要求设置输入、输出变量。

（2）按输入、输出变量之间的逻辑关系列出真值表。

（3）由真值表写出逻辑函数式，并通过化简得到最简逻辑函数式。

（4）由最简逻辑函数式绘出逻辑电路图。

（5）用实际元器件实现逻辑电路。

2．答：输入变量的某些取值在工作过程中始终不会出现，这些最小项称为约束项。

既然约束项不会出现，那么将约束项加到函数式中或者从函数式中删掉，对函数没有影响。

约束项在卡诺图中用符号“×”表示，在化简过程中，可以根据需要将这些约束项看作1或者0。

3．解：4．解：Y=m(7,11,13,14,15)=ABD+ABC+ACD+BCD =ABD ABC ACD BCD∑⋅⋅⋅任务三应用编码器、译码器组装十进制数码显示电路一、填空题1．编码2．8421BCD3．优先4．编码5．8421BCD码七段字形显示码6．七7．阳阴二、问答题1．答：74LS147输入端9I的优先级别最高，其他依次降低，1I的优先级别最低。

输入端0I 隐含。

2．答：输出编码信号是8421BCD码的反码。

3．答：CD4511拒绝非8421码，当输入信号是1010～1111时，输出数据全为0。

4．答：共阴极、共阳极数码管分别用高、低电平驱动。

CD4511和74LS48驱动共阴极数码管；74LS47驱动共阳极数码管。

任务四应用数据选择器组装三地开关控制电路一、填空题1．多一2．多一二、问答题1．答：当使能端无效时，数据选择器被禁止；当使能端有效时，数据选择器处于工作状态。

2．答：数据选择器的输出信号由地址码选择决定。

3．答：对应D7，D5，D2，D1的地址码分别是111B，101B，010B，001B。

三、设计题任务五应用加法器组装BCD码转余3码电路一、填空题1．进位半加2．进位全加二、判断题1．×2．×三、问答题1．答：一片74LS283加法器只能完成4位二进制数的加法运算。

2．答：要完成十六位二进制数相加需要4片74LS283。

任务六应用数值比较器组装工件规格识别电路一、填空题= < < > < = >二、选择题1．B 2．A 3．C三、判断题1．×2．√3．√ 4．√课题三触发器的应用任务一应用RS触发器制作手动脉冲信号发生器一、填空题1．两翻转2．记忆一3．与非4．输入5．输出记忆6．1 0二、判断题1．×2．×3．√三、绘图题1．2．任务二学习和测试JK触发器一、填空题1．0 0 2．1 1 3．0 1 4．1 05．保持翻转置0 置1二、绘图题1．任务三应用D触发器组装4人抢答器一、判断题1．√2．√3．× 4．√二、绘图题1．2．任务四触发器功能转换1．2．3．5．6．7．8．9．课题四组装与测试时序逻辑电路任务一分析和测试给定的时序逻辑电路问答题1．答：时序逻辑电路的特点是，输出不仅取决于当时输入的状态，还与电路原来的状态有关。

2．答：时序逻辑电路按触发方式可分为“同步”和“异步”两大类。

在同步时序逻辑电路中，所有触发器的时钟脉冲输入端CP都连在一起，使所有触发器的状态变化和时钟脉冲信号CP同步发生。

在异步时序电路中，时钟脉冲信号CP只触发部分触发器，其余触发器则是由电路内部信号发出的，因此，各个触发器的状态变化有先有后，并不都与时钟脉冲CP同步，所以异步时序逻辑电路的工作速度低于同步时序逻辑电路。

3．答：分析时序逻辑电路可按以下步骤进行：（1）分析电路的基本组成，写出各触发器的时钟方程、驱动方程和时序逻辑电路的输出方程。

（2）将驱动方程代入相应触发器的特性方程，求出时序逻辑电路的状态方程。

（3）根据状态方程和输出方程，列出时序逻辑电路状态转换表，画出状态转换图或时序图。

（4）根据状态表、状态图或时序图确定时序电路的逻辑功能。

4．答：2位计数器的模是4，3位计数器的模是8，4位计数器的模是16。

5．答：计数器从最大状态翻转为0状态时，计数器进位输出端输出进位信号。

6．答：计数器从最小状态0翻转到最大状态时，计数器借位输出端输出借位信号。

任务二组装与测试集成二进制加法计数器一、问答题1．答：计数器有以下几种分类：（1）按数字变化规律，可分为加法（递增）计数，减法（递减）计数和加/减可逆计数。

（2）按计数的进制不同，可分为二进制、十进制或N（任意）进制。

（3）按触发方式不同，可分为同步计数和异步计数。

（4）按清零方式，可分为同步清零和异步清零。

（5）按置入数据方式，可分为同步置入数据和异步置入数据。

2．答：同步清零（或置入数据）在时钟脉冲CP到达时刻才能清零（或置入数据），异步清零（或置入数据）则不受CP限制。

3．答：74LS161是同步置数异步清零，74LS163是同步置数同步清零。

4．答：74LS161的进位信号CO是下降沿有效。

由时序图可以看出，进位信号CO在第15个CP脉冲上升沿时刻上升为高电平，在第16个CP脉冲上升沿时刻产生一个下降沿进位信号，CO脉冲宽度为一个CP周期。

5．答：异步清零，同步置数，数据保持，加法计数二、绘图题1．参见教材图4-12。

2．参见教材图4-13。

任务三组装与测试集成二进制加/减可逆计数器一、问答题1．答：74LS193是二进制加减可逆计数器，74LS161是二进制加法计数器。

2．答：74LS193为异步置数，74LS161为同步置数。

3．答：74LS193是双时钟计数输入，74LS161是单时钟计数输入。