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基于带通采样的高速数据采集系统设计
3.2性能指标计算
1)信噪失真比(SINAI)):在第一奈奎斯特频带内,取基频和其两旁适当数目的采样值的均方根作为信号的
有效值,其余采样值的均方根作为噪声的有效值,它包括量化噪声、ADC的谐波噪声、超越噪声以及FFT的舍
人误差。其计算公式为:
SINAD=2019f 4删(r-4/k(FInS)l
(3)
该带通采样定理适用的前提条件:只允许在一个 频带上存在信号,而不允许在不同的频带上同时存在 信号,否则将会引起信号混叠。
1.2带通采样中的频谱反转
带通采样的结果是把位于(MB,(M+1)B)(M=0,
l,2,…)频带上的信号都用位于(O,功上相同的基带信
号频谱来表示,但是当M为奇数时,其频谱相对中
絮。
系统开始工作后,FPGA接收ADC采样输出数据。数据率转换模块对数据进行双沿采样,得到8路250 Mbps 的数据流,再通过8个串并转换器得到16路125 Mbps的数据流。编码转换与数字修正模块对16路数据进行偏 移码转二进制补码和反转频谱数字修正等预处理。根据预处理之后的数据。利用自相关法对信号进行能量检测, 配合视频检波信号判别数据是否有效【6J,并提供相应的写控制信号,将有效数据分成4路,每路32 bit写入外部 4个FIFO【.¨。数据率转换模块与存储结构如图5所示。
HE Xiao-dong,DING Li (School of Electronic Engineering,UESTC,Chengdu Sichutm 61 1731,China)
Abstract:High—speed data acquisition system is an important component in modcITl radar signal processing.A design of high—speed data acquisition system based on band—pass sampling wag presented and applied to the signal processing of wideband receiver.The Virtex Series FPGA was used ag the main platform to control the high·speed ADC08D1000 for completing data acquisition,transmission,storage and signal processing.High—speed First Input First Output(FIFOs)were selected aS the storage devices to implement data rate conversion.The system realized the software and hardware design,and test results verified the feasibility of the solution.
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高速数据采集系统按具体功能分为:模拟信号调理电路、时钟电路、ADC采样电路以及采样数据接收、缓 存与处理电路。
模拟信号调理电路是在保证被采样信号不失真的前提下,对信号进行低噪声放大或衰减、滤波和电气隔离等
Key words:band—pass sampling;data acquisition;ADC08D1000;FPGA
随着现代信息技术的快速发展,各种数据的采集与实时处理,已成为信息研究领域不可或缺的主要组成部分。 在雷达信号侦察、遥感、地质勘探、无损检测、智能仪器及医学影像等领域,人们对数据采集系统的采样精度、 采样率和处理速度等指标提出了更高的要求。
传统的数据采集系统往往采用单片机或数字信号处理器作为主控单元。基于单片机的数据采集系统由于单片 机本身指令周期与速度的影响,其时钟频率较低,不能满足现代信号处理系统对数据采集的实时性与同步性要求。 基于数字信号处理器DSP(DigitalSignalProcessor)的数据采集系统虽然处理速度快,但是DSP频繁的中断会降低系 统的效率‘11。
时钟电路主要由高性能频率综合器LMX253 l完成,LMX253 l内部集 成了模拟锁相环、压控振荡器和可调的环路滤波器,通过内部配置寄存器 可以产生917 MHz~l 024 MHz和1 834 MHz~2 028 MHz频段范围内的任 意单频时钟信号,能够为本系统提供l GHz采样时钟[510
ADC采样电路的模数转换器选用美国国家半导体公司的 ADC08D1000,这是一款高性能的模数转换器,它具有双通道结构,每个通 道的最大采样率为1.6 GSPS,采用双通道互插模式时,采样率可达2 GSPS。 该芯片全功率带宽为1.7 GHz(正常模式1或900 MHz(DES(Data Encryption Standard)模式,交叉采样),采用1.9 V电源供电,510 mVp-P或710 mVp.P 可调差分输出。本设计中,ADC08D1000通过2个l:2复用器将采样后的 数据分为I,Id,Q,Qd 4路并行数据,数据率500 Mbps,时钟频率250 MHz, 以DDR(Double Data Rate)方式送给FPGA。FPGA将预处理后的数据送给外 部存储器。外部存储器选用IDT公司的IDT72T36125双口异步FIFO,位 宽为36 bit。
软件、硬件设计,测试结果验证了方案的可行性。 关键词:带通采样;数据采集;ADC08D1000芯片;现场可编程门阵歹Ij
中图分类号:TN971.1
文献标识码:A
Design of high--speed data acquisition system based on band—-pass sampling
本文提出了一种以FPGA为核心控制器,FIFO为外部存储器,基于带通采样的高速数据采集系统。将 ADC08D1000芯片输出的带通采样数据经过FPGA预处理后存入外部FIFO中,同时利用RS232接口与PC机通 信,方便数据的进一步分析与处理,最后给出了测试结果。
1 带通采样
根据Nyquist采样定理,对于最高频率为厶。的低通信号,要求ADC(Analog Digital Converter)f19采样频率
7
o眦l,oul2'…,outl6
Fig.5 Data rate conversion and storage structure 图5数据率转换与存储结构图
3 测试结果及性能指标
ADC的主要性能参数包括:采样率、有效位数ENOB(Effective Number Of Bits)、信噪比SNR(Signal.to-Noise Ratio)、信噪失真比SINAD(Signal-to—Noise Plus Distortion Ratio)、无杂散动态范围SFDR(Spurious—Free Dynamic Range)和总谐波失真THD(Total Harmonic Distortion)等。常用的测试方法是对采样数据进行FFT,在频域对ADC 进行动态性能评估‘8—91。
l/,UU Mbpk Id/500 Mbos。 Q/500 Mbl)t Od/500 MbpsL| CLK/250 MHz.
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transcoding and di百tal dressing
D16
牛=1: 叫signal det鲥0n M锄。觚- ,作n丧.。.. 。。m。。伽n川.
3.1测试结果
测试条件:以2 GSPS的速率对(1 GHz,2 GHz)内的信号进行带通采样,选取1.2 GHz的连续单频正弦信号作 为测试信号,测试频域图如图6、图7所示。
万方数据
3Hale Waihona Puke 6信息与电子工程第8卷
Fig.6 Frequency spectrum of 1.2 GHz single-frequency sinusoidal signal
由式(3)可以算出信噪失真比黝忉D=41.44 dB。
2)信噪比(SNR):在第一奈奎斯特频带内,取基频和其两旁适当数目的采样值的均方根作为信号的有效值,
RsN=2019石裔‰ 除去谐波分量采样值的均方根作为噪声的有效值。其计算公式为:
万方数据
第3期
和小东等:基于带通采样的高速数据采集系统设计
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预处理,以提高信噪比,减少畸变,改善信号质量,以及变换信号来适应
ADC的输入要求【4】。采用射频变压器ADTL2-18将单端信号转换为差分形 式:一路通过射频微波继电器RF303进行隔离后送至VinQ一“输入端口: 另一路通过全差分放大器LMH6552将输入信号调整至适合ADC采样的范 围内并送至VinQ一/+输入端口。
图6 1.2 GHz单频正弦信号采样后频谱图
Fig.7 Revised frequency speclxum of 1.2 GHz
single-frequency sinusoidal signal
图7 1.2 GH蝉频正弦信号采样修正后频谱图
测试中利用带通采样频谱出现了“反转”,其原始信号采样的频域和经过数字修正之后信号的频域情况分别如 图6、图7所示。其中图6为接收信号直接FFT的频谱特征,可以看到在(0,1 GHz)内发生了频谱反转;图7是经 过数字修正之后,其对应的频域特征,可知在经过时域的数字修正后,频域上消除了频谱反转现象。
第8卷第3期 2010年6月
信 息 与 电 子 工程
INFORMATION AND ELECTRONIC ENGINEERING
V01.8,No.3 Jun.,2010
文章编号:1672—2892(2010)03-0313-05