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• 例如：我们现有M进制计数要构成N 进制计数器。当N<M时，则只需一 片M进制计数器；如果N>M时，则要 多片M进制计数器。
反馈清零法：适用于具有清零输入端 M进制计数构成N进 制计数器基本方法 的集成计数器
反馈置数法：适用于具有预置数功能 的集成计数器
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• 根据反馈清0画出6进制计数器电路图
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•反馈清0法设计24进制计数器
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用反馈清0法设计8×3＝24和 4×6＝24进制的计数器
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• 大家好好想想吧
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实验内容 一、测试74LS192的逻辑功能
1、测试74LS192的清0和并行置数功能填下表 输 入 输 出 CR LD D C B A QD QC QB QA 1 × × × × × 0 0 0 0 0 1 0 0 1 0 0 1 0 0 0 1 0 1 0 0 0 1 1 0
按要求画出电路图，安装电路，观察并画 出状态转换图。
七、设计一个用开关控制的可逆计数器
按要求画出电路图，扳动加开关进行加计 数，扳动减开关进行减计数的可逆计数器。
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实验报告要求
• • • • • • 写清实验目的、实验设备和器件 拟出各实验内容中测试所需的表格 画出完整的实验电路图 整理实验数据并填入表格中 画出规范的波形图 对实验现象和结果进行分析
计数器及其 ——应用设计
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实验目的
• 了解计数器的功能和特点。 • 熟悉任意计数器的设计方法，
并掌握其应用。
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计数器介绍
• 计数器是数字系统中不可缺少 的时序逻辑器件，不但可以实 现计数、分频，还可以实现测 量、运算和控制等功能，在实 践中应用很广。
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二进制加法计数器
Q2 Q1
Q0
R
Q
Q
Q
CP
Q D
Q D
Q D
S
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二、计数功能检查
画出加法、减法计数状态转换图。
三、自启动功能检查
加法计数预置在1010；减法计数预 置在 1111；画出它们的状态转换图。
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四、用74LS192构成一个三进制加法计数器
1、时钟用单次脉冲，观察并记录状态变化。 2、时钟改为1KHZ，用示波器观察并画出CP、 QA、QB的波形，并测出CP、QA和QB的参 数。 CP QB QA CP f T Vm
计数器分类
同步计数器 按时钟的连 接方式 异步计数器 按结构 COMS计数器 TTL计数器
按计数的
二进制计数器 十进制计数器 其它进制计数器 按计数 的增减
加法计数器 减法计数器 可逆计数器
循环长度
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•虽然集成计数器的规格和型号很 多，但也不可能任意进制的计数 器都有与之相对应的集成产品。 这就要求我们学会用现有的成品 计数器外接器件及线路，构成适 合自己需要的计数器。
应用设计
• 实际应用时可以用中规模集成计数 器根据应用需要构成任意进制的计 数器。
• 实验中采用的中规模集成计数器 74LS192，它具有双时钟输入，同 时具有清0和置数功能的同步十进制 可逆计数器。 四川大学电工电子实验中心
74LS192的管脚图及示意图
74LS192 示意图
•
D、C、B、A —— 置数并行数据输入； QD、QC、QB、QA —— 计数数据输出； CR —— 清零端； LD —— 置数端； CPU—— 加法计数CP输入； CPD ——减法计数CP输入； CO —— 进位输出端； BO —— 借位输出端；
QA
QB
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五、设计一个41进制的计数器
1、时钟CP为1HZ，用发光二极管或数码管观 察并画出状态转图。 2、时钟CP为20KHZ，记录CP和QC’的波形， 测试CP和QC’的频率、峰值、正脉宽等参 数。
频率f CP QC’ 峰值Vpp 正脉宽tp
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六、设计一个时钟表面时数的计数器
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• 74192功能 表 输入
CR LD
CPU CPD
输出
C B A QD QC QB QA
D
1
×
×
×
×
×
×
×
0
0
0
0
0
0
×
×
D
C
B
A
D
C
B
A
0 0
1 1 1
1 × × × × × × × ×
加法计数 减法计数
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•反馈清0法设计6进制计数器
因为N<M,所以用一块74LS192芯片 • 六进制计数状态 QD QC QB QA 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0*